1樓：南瓜蘋果
多餘輸入端接地和接0是乙個意思，都是接的低電位；懸空和接1也是乙個意思，都是高電位。
但是cmos電路的輸入端是不允許懸空的，因為懸空會使電位不定，破壞正常的邏輯關係。另外，懸空時輸入阻抗高，易受外界雜訊干擾，使電路產生誤動作，而且也極易造成柵極感應靜電而擊穿。
所以「與」門，「與非」門的多餘輸入端要接高電平，「或」門和「或非」門的多餘輸入端要接低電平。若電路的工作速度不高，功耗也不需特別考慮時，則可以將多餘輸入端與使用端併聯。
擴充套件資料
閘電路應用注意事項：
對於或門及或非門的多餘輸入端，可以使其輸入低電平。具體措施是通過小於500ω的電阻接地或直接接地。
在前級門的扇出係數有富餘時，也可以和有用輸入端併聯連線。對於與或非門，若某個與門多餘，則其輸入端應全部輸入低電平（接地或通過小於500ω的電阻接地），或者與另外同乙個門的有用端併聯連線（但不可超出前級門的扇出能力）。
若與門的部分輸入端多餘，處理方法和單個與門方法一樣。
2樓：匿名使用者
接地包括模擬訊號地，電源地，數碼訊號地，是乙個參考電位，不一定為0v；
接0是指數碼訊號輸入接地或通過乙個小電阻接地，也可以是不超過乙個小電位的電壓；
懸空在有些電路中相當於高電位，是因為晶元內部有上拉電阻，所以懸空相當於預設接高電位，但有些電路就會產生不可知問題，所以建議不要懸空引腳。
ttl門和cmos門懸空引腳如何處理？
3樓：哇哎西西
ttl門的輸入引腳可以懸空
，懸空狀態的輸入相當於高電平輸入。cmos輸入引腳不能懸空，內應接高電平或0。
ttl和***s電路比較容：
1、ttl電路是電流控制器件，而***s電路是電壓控制器件。
2、ttl電路的速度快，傳輸延遲時間短（5-10ns），但是功耗大。
3、***s電路的速度慢，傳輸延遲時間長（25-50ns），但功耗低。
4、***s電路的供電電壓高於ttl電路，也就是可以工作在較寬的電壓範圍之內。
4樓：匿名使用者
ttl閘電路一般bai由晶體三極體電路構du成。對於ttl電路多
zhi餘輸入端dao的處理,應採用以下方法回
：ttl與門和與非門電答路：
將多餘輸入端接高電平，即通過限流電阻與電源相連線；
根據ttl閘電路的輸入特性可知，當外接電阻為大電阻時，其輸入電壓為高電平，這樣可以把多餘的輸入端懸空，此時輸入端相當於外接高電平；
通過大電阻（大於1kω）到地，這也相當於輸入端外接高電平；
當ttl閘電路的工作速度不高，訊號源驅動能力較強，多餘輸入端也可與使用的輸入端併聯使用。
ttl或門、或非門：
接低電平；
接地；由ttl輸入端的輸入伏安特性可知，當輸入端接小於ikω的電阻時輸入端的電壓很小，相當於接低電平，所以可以通過接小於ikω（500ω）的電阻到地。
cmos 閘電路一般是由mos管構成，在使用cmos閘電路時輸入端特別注意不能懸空
與門和與非門電路：多餘輸入端應採用高電平，即可通過限流電阻（500ω）接電源。
或門、或非門電路：多餘輸入端的處理方法應是將多餘輸入端接低電平，即通過限流電阻（500ω）接地。
5樓：匿名使用者
ttl門的輸入引腳可以懸空,懸空輸入是高電平.cmos輸入不用的引腳應接高電平或0.兩種電路的沒用的輸出,懸空.
在數位電路中ttl與非門的多餘的輸入端應如何處理？有幾種方法？ 20
6樓：湯瑞愛
ttl與非門在使用時如果有多餘端子不用一般不應懸空，有以下處理方式：
1.將其經1~3千歐電阻接正電源正端
2.接高電平vh
3.與其他訊號輸入端並接使用
ps:或非及或閘電路的多餘輸入端子應接低電平。與門其輸入端子必須接低電平
7樓：新醬
ttl與非門電路多餘
輸入端的處理有四種方法 ：
1、將多餘輸入端接高電平．即通過限流電阻與電源相連線。
2、根據ttl閘電路的輸入特性可知，當外接電阻為大電阻時．其輸入電壓為高電平。這樣可以把多餘的輸入端懸空．此時．輸入端相當於外接高電平。
3、通過大電阻到地，這也相當於輸入端外接高電平。
4、當ttl閘電路的工作速度不高．訊號源驅動能力較強．多餘輸入端也可與使用的輸入端併聯使用。
非門：非門（英文notgate），又稱反相器，是邏輯電路的基本單元，非門有乙個輸入和乙個輸出端。非門是基本的邏輯門，因此在ttl和cmos積體電路中都是可以使用的。
別稱 ：
反相器適用領域範圍：
邏輯 外文名：
not gate
應用學科：
物理實質：
邏輯電路的基本單元
8樓：奮鬥小朱
對於ttl電路，與非門多餘的不接，相當於高電平，故對於與非門多餘的可以接高電平或懸空；
對於cmos電路，多餘的門不接，狀態不確定，故只能接高電平！
9樓：匿名使用者
第一、接高電平；第
二、懸空。
10樓：風雷小草
接高電平，如果是或非門，則應接低電平。
CMO與TTL與非門電路多餘輸入端的處理方法，各種輸入方法之間有什麼特點
1 cmos與非門電路多餘輸入端的處理 與非門電路的邏輯功能是輸入訊號只要有低電平 輸出訊號就是高電平 只有當輸入訊號全部為高電平時 輸出訊號才是低電平。所以某輸入端輸入電平為高電平時 對電路的邏輯功能並無影響 即其它使用的輸入端與輸出 端之間仍具有與或者與非邏輯功能。這樣對於cmos與門 與非門電...
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